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以发送方向为例，MAC侧芯片先准备好tx_en,tx_er,tx[7:0]这10个bit准备发给PHY，如果是并行的，需要10根管脚加一个125MHz的时钟就可以实现Gbps的速率了，但是11根管脚太多了，大家想用一对差分线2根管脚来输送这10个bit，如果要想达到Gbps的速率，这根差分线的速率就是10/8*1Gbps，这样PHY侧收到了10个bit，但是tx_en和tx_er这两个是以太网csma/cd功能所需的信号，不属于物理层的数据，只有tx[7:0]这8个bit才是我要传输的数据，所以去掉tx_en和tx_er，把剩余的8个bit直接发送出去，但是发送8个bit需要8根线，太多管脚了，咋办，利用并串转换（serdes技术），这样就只用两根管脚（一对差分线），来串行的发送8个bit，那么问题来了，万一8个bit一直是全0或者全1，没有0和1的翻转，如何过变压器？如何过耦合电容？如何感觉时钟沿，如何提取时钟？好，把8个bit通过算法插入2bit保证全0或全1的时候仍然有0和1的翻转，速率又变成10/8*1Gbps，PCS侧的功能完成差不多了，这1.25Gbps进入PMA……